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Timing analysis speed-up using a hierarchical and a multimode approach

Blaquière, Yves et Dagenais, Michel et Savaria, Yvon. 1996. « Timing analysis speed-up using a hierarchical and a multimode approach ». IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, vol. 15, nº 2. p. 244-255.

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Type de document: Article publié dans une revue, révisé par les pairs
Professeur:
Professeur
Blaquière, Yves
Affiliation: Autres
Date de dépôt: 20 févr. 2017 19:28
Dernière modification: 20 févr. 2017 19:28
URI: http://espace2.etsmtl.ca/id/eprint/14619

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